Périphériques Intel® eASIC™ N3XS
La famille d’appareils Intel® eASIC™ N3XS est la plate-forme ASIC de cinquième génération d’Intel et repose sur un processus CMOS 28nm. Les appareils Intel® eASIC™ N3XS fournissent aux concepteurs une solution idéale lorsque la faible puissance, les performances élevées, le délai de mise sur le marché et le coût total de possession sont primordiaux. La famille d’appareils Intel® eASIC™ N3XS dispose d’une architecture optimisée qui est idéale pour les conceptions logiques, DSP ou gourmandes en mémoire et fournit plus d’un térabit de bande passante en utilisant une combinaison d’émetteurs-récepteurs haute vitesse de 28 Gbps et 16 Gbps.
Périphériques Intel® eASIC™ N3XS
Périphériques Intel® eASIC™ N3XS
| N3XSTe3 | N3XSTe5 | N3XSTe9 | N3XSTe11 | N3XSTe15 | |
|---|---|---|---|---|---|
| ECells équivalents (K) | 410 | 1,040 | 1,558 | 3,863 | 5,262 |
| Portes ASIC équivalentes (M) | 4 | 10 | 16 | 39 | 52 |
| LCells | 556,800 | 1,412,880 | 2,115,840 | 5,247,840 | 7,147,920 |
| ACells | 172,800 | 438,480 | 656,640 | 1,628,640 | 2,218,320 |
| EDFFs | 230,400 | 584,640 | 875,520 | 2,171,520 | 2,957,760 |
| blocs bRAM18K (taille 18Kbit) | 456 | 1,176 | 1,776 | 4,446 | 6,084 |
| bRAM18K (Kbits) | 8,405 | 21,676 | 32,735 | 81,949 | 112,140 |
| Blocs Regfile2K (taille 2Kbit) | 450 | 1,161 | 1,751 | 4,431 | 5,977 |
| Regfile2K (Kbits) | 922 | 2,378 | 3,607 | 9,075 | 12,241 |
| Mémoire totale (Kbits) | 9,327 | 24,054 | 36,342 | 91,023 | 124,381 |
| L PLL | 6 | 12 | 14 | 20 | 24 |
| MGIO 16 (16.3Gbps) | 8 | 12 | 32 | 24 | 32 |
| MGIO 28 (28Gbps) | 0 | 0 | 0 | 24 | 32 |
| E/S hérité | 62 | 62 | 62 | 62 | 62 |
| E/S haute vitesse | 232 | 372 | 522 | 738 | 882 |
Options de forfait
| N3XSTe3 | N3XSTe5 | N3XSTe9 | N3XSTe11 | N3XSTe15 | |
|---|---|---|---|---|---|
| CS484 |  |
||||
| CF484 | |
|
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| FC529 | |
|
|||
| CF572 | |
|
|
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| FC676 | |
|
|
|
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| FC780 | |
|
|
|
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| CF1152 | |
|
|
||
| FC1517 | |
Les forfaits sont représentatifs, d’autres options de forfaits personnalisés sont disponibles pour répondre aux exigences de conception uniques.
Documentation
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