FPGA Intel® IP Interlaken
Le cœur IP du FPGA Intel® Interlaken est conforme à la définition du protocole d'Interlaken v1.2 et permet aux développeurs de systèmes d'obtenir une bande passante élevée sur leurs systèmes. Ce composant de base IP préconstruit et prêt à l'emploi raccourcit le cycle de conception, ce qui accélère la mise sur le marché.
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FPGA Intel® IP Interlaken
Interlaken est un protocole d'interconnexion conçu pour les interfaces puce à puce à haut débit canalisées dans les applications de mise en réseau. Il est optimisé pour les transferts de paquets puce à puce à large bande passante, avec des débits allant de 10 Gbit/s à 600 Gbit/s et au-delà.
Le cœur Intel® FPGA IP d'Interlaken est idéal pour :
- Routeurs et commutateurs multi-térabit pour l'accès
- Applications Ethernet et de centre de données qui exigent une configurabilité IP pour optimiser les différents profils de trafic
- Évolutivité pour les plateformes nouvelle génération
Exemples de conception matérielle d'un bouton de commande dans le logiciel Intel® Quartus® Prime
Caractéristiques
Intel fait partie de l'Alliance Interlaken depuis sa création en 2007 et continue d'innover. L'entreprise propose de nouvelles fonctionnalités de protocole pour fournir aux clients des solutions IP d'Interlaken robustes et faciles à mettre en œuvre. Intel propose désormais une IP Interlaken jusqu'à 600G.
Avec la sortie des FPGA Intel® Arria® 10 et SOC de nouvelle génération, la gamme d'IP du FPGA Intel Interlaken franchit des étapes de développement majeures : IP logicielle de troisième génération (inclut une sous-couche MAC) et IP renforcée de deuxième génération (inclut une sous-couche de codage physique (PCS) / un attachement au support physique (PMA)). Ces cœurs expérimentés et éprouvés continuent de fournir la robustesse et la maturité supplémentaires requises pour de nouveaux systèmes plus intelligents.
- Sélection du débit de données jusqu'à 25,78125 Gbit/s (NRZ) ou 56 Gbit/s (PAM4)
- Configuration multi-voies jusqu'à 24 voies
- Prise en charge du mode paquet Interleave
- Planification améliorée
- Options d'interface de l'utilisateur d'aligement multi-segment ou SOP (Start-of-Packet)
- Paramètres de rafale contrôlables par E/S (Min, Max, Short)
- Longueurs des méta-trames programmables
- Jusqu'à 256 canaux logiques
- Accès aux champs à usage multiple
- Contrôle de flux intrabande et extrabande (options de page de calendrier)
- Capacités avancées de traitement et d'injection d'erreurs
- Retransmission
- IP entièrement intégrée (couches MAC, PCS et PMA)
- Paramètres de préaccentuation et d'égalisation réglables
- Des livraisons d'IP personnalisées sont disponibles pour optimiser les besoins des différentes applications
- Prend en charge le mode ILA
Statut IP
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Statut de commande |
Production |
Codes de commande | |
20G à <100G |
IP-ILKN/50G |
100G à <200G |
IP-ILKN/100G |
200G à <400G |
IP-ILKN/200G |
Voir aussi…
Documentation
- Manuel d'utilisation du FPGA Intel® IP Interlaken (2ᵉ génération)
- Manuel d'utilisation de la fonction Interlaken MegaCore 50G
- Manuel d'utilisation de l'exemple de conception Interlaken 50G
- Manuel d'utilisation de la fonction Interlaken MegaCore 100G
- Manuel d'utilisation de l'exemple de conception Interlaken 100G
- Manuel d'utilisation de l'exemple de conception du cœur IP Interlaken (2ᵉ génération)
- Guide de l'utilisateur F-Tile Interlaken Intel® Intel® FPGA IP
- Guide de l'utilisateur de l'exemple de conception F-Tile Interlaken Intel® Intel® FPGA IP
- Notes de version Intel® FPGA IP
Autres ressources
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