Cœur IP du FPGA Intel® Serial Lite IV
Le cœur de propriété intellectuelle (IP) du FPGA Intel® Serial Lite IV convient à la communication de données à large bande passante pour les applications puce à puce, carte à carte et de fond de panier.
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Cœur IP du FPGA Intel® Serial Lite IV
Le cœur IP Serial Lite IV intègre une couche MAC (Media Access Control), une sous-couche de codage physique (PCS) et un bloc d'attachement au support physique (PMA). L'IP prend en charge le transfert de données jusqu'à 58 Gbit/s par voie, avec un maximum de 12 voies PAM4 d'émetteurs-récepteurs à usage général (FGT) Intel® Agilex™ F-tile, et jusqu'à 116 Gbit/s avec un maximum de 4 voies PAM4 d'émetteurs-récepteurs à grande vitesse (FHT) Intel® Agilex™ F-tile en une liaison unique, ou 28 Gbit/s par voie avec un maximum de 16 voies sans retour à zéro (NRZ) de FGT et 58 Gbit/s par voie avec un maximum de 4 voies NRZ de FHT. Ce protocole offre une large bande passante, des trames peu élevées, un faible nombre d'E/S, et supporte un nombre de voies et des vitesses très évolutif. L'IP est facilement reconfigurable. Le mode Ethernet PCS des émetteurs-récepteurs E-Tile et F-Tile lui permet de prendre en charge une large gamme de débits de données.
Cette IP prend en charge deux modes de transmission :
- Mode basique-- Il s'agit d'un mode de partage pur, où les données sont envoyées sans le début du paquet, le cycle vide et le paquet de fin pour augmenter la bande L'IP considère la première donnée valide comme le début d'une rafale.
- Mode Full-- Il s'agit du mode de transfert de données par paquets. Un cycle de rafale et de synchronisation est envoyé comme délimiteurs au début et à la fin d'un paquet.
Caractéristiques
Caractéristiques | Descriptif |
---|---|
Transfert de données |
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PC |
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Détection et traitement des erreurs |
|
Interfaces |
|
Statut IP
Statut de commande | Production |
Codes de commande | |
FPGA Intel® IP pour streaming série Lite III |
IP-SLITE4 |
Voir aussi…
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