PI FPGA Intel® Ethernet à triple vitesse
PI FPGA Intel® Ethernet à triple vitesse
Présentation
Le cœur Intel® FPGA IP Triple-Speed Ethernet se compose d'une propriété intellectuelle (IP) de contrôle d'accès au support (MAC) et de sous-couche de codage physique (PCS) Ethernet 10/100/1000 Mbps. Cette fonction IP permet aux FPGA Intel® de s'interfacer avec un appareil Ethernet PHY externe, qui se connecte au réseau Ethernet.
Cette IP est proposée en mode MAC-only ou en mode MAC+PHY En mode MAC uniquement, l'IP utilise une puce PHY externe pour effectuer la signalisation. Les deux interfaces prises en charge vers les PHY externes sont : GMII (interface 8 bits à 125 MHz SDR) et RGMII (interface 4 bits à 125 MHz DDR).
En mode MAC+PHY, le PHY est réalisé à l'aide de transceivers intégrés ou d'E/S LVDS avec une logique d'alignement de phase dynamique (DPA) qui peut fonctionner jusqu'à 1,25 Gbps. Le protocole SGMII ou 1000Base-X est utilisé dans ce cas. L'utilisation des E/S LVDS permet de concevoir des systèmes Gigabit Ethernet (GbE) multiport très évolutifs tout en réservant les transceivers série à des protocoles plus performants.
Fonctionnalités
- IP Ethernet 10/100/1000 Mbps complet avec tous les modules IP nécessaires
- 10/100/1000 Mbps MAC, PCS et PMA
- Options IP flexibles
- MAC uniquement, PCS uniquement, MAC + PCS, MAC + PCS + PMA, PCS + PMA
- De nombreuses options pour diverses applications et tailles aussi petites que 900 éléments logiques (small-MAC)
- Compteurs statistiques standard prenant en charge la base d'informations de gestion (MIB et MIB-II) du protocole de gestion de réseau simple (SNMP) et la surveillance de réseau à distance (RMON).
- Options MAC FIFO ou FIFO paramétrables
- Option d'horodatage de haute précision IEEE 1588 v2 dans le matériel IP
- Synchronisation temporelle en 1 et 2 étapes
- Prend en charge l'encapsulation des paquets PTP IEEE 1588 v2 en IPv4, IPv6 et Ethernet.
- Exemple de conception d'un générateur d'horloge en temps réel (ToD) IP
- De nombreuses options d'interface Ethernet externe pour diverses familles Intel® FPGA
- MII (10/100 Mbps), GMII, RGMII et SGMII (10/100/1000 Mbps), 1000 BASE-X et TBI (1 Gbps)
- Données de gestion E/S (MDIO) pour la gestion des périphériques PHY externe
| Infos de commande | |
|---|---|
| Code de commande | IP-TRIETHERNET : Ethernet triple vitesse IP-TRIETHERNETF : IEEE 1588v2 pour Ethernet triple vitesse |
Mesures de qualité de PI
Basique |
Option 1588 v2 |
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|---|---|---|
Année où l'IP a été publiée pour la première fois sous forme d'Intel FPGA IP |
2017 |
2017 |
Première version du logiciel Intel Quartus Prime prise en charge |
17,2 |
17,2 |
État |
Production |
Production |
Livrables |
Option 1588 v2 |
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Les livrables du client comprennent les éléments suivants : Fichier de conception (code source crypté ou netlist post-synthèse) Simulation model for ModelSim*- Édition FPGA Intel Contraintes de synchronisation et de topologie Documentation avec contrôle de révision Fichier Readme |
O |
O |
Tout autre livrable du client fourni avec la PI |
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GUI de paramétrage permettant à l'utilisateur final de configurer la PI |
O |
O |
Le cœur de PI est activé pour la prise en charge d'Intel FPGA IP Evaluation Mode |
O |
O |
Langue source |
Verilog |
Verilog |
Langue du banc d'essai |
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Pilotes logiciels fournis |
N |
N |
Assistance SE du pilote |
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Déploiement |
Option 1588 v2 |
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Interface utilisateur |
MII (10/100 Mb) GMII ou RGMII (1000 Mbps) |
MII (10/100 Mb) GMII ou RGMII (1000 Mbps) |
Métadonnées IP-XACT |
N |
N |
Vérification |
Option 1588 v2 |
|
Simulateurs pris en charge |
Mentor Graphics*, Synopsys*, Cadence* |
Mentor Graphics*, Synopsys*, Cadence* |
Matériel validé |
Intel Arria 10, Intel Stratix 10, Intel Cyclone 10 GX |
Intel Arria 10, Intel Cyclone 10 GX |
Tests de conformité aux normes de l'industrie effectués |
Conformité UNH IEEE 802.3 |
UNH IEEE 802.3 pour MAC/PH, N/A pour l'option 1588. |
Si oui, quel(s) test(s)? |
Clause 4, 46, 31 et 49 |
Clause 4, 46, 31 et 49 |
Si oui, sur quel(s) FPGA Intel ? |
Intel Arria 10 |
Intel Arria 10 |
Si oui, date réalisée |
2011 |
2012 |
Si non, est-ce prévu? |
|
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Interopérabilité |
Option 1588 v2 |
|
La PI a subi des tests d'interopérabilité |
N |
N |
Si oui, sur quel(s) FPGA Intel |
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Rapports d'interopérabilité disponibles |
N |
N |
Liens connexes
Documentation
- Conceptions de référence
- Conception de référence FPGA Intel® Stratix® 10
- Conception de référence FPGA Intel® Arria® 10 #1
- Conception de référence FPGA Intel® Arria 10 #2
- Conception de référence FPGA Stratix® V
- Conception de référence FPGA Intel® MAX® 10
- AN 440 : Accélération des applications de réseau Nios® II (PDF)
- Guide de l'utilisateur Ethernet triple vitesse Intel FPGA IP (PDF)
† Les tests mesurent les performances des composants sur un test particulier, dans des systèmes spécifiques. Toute différence matérielle, logicielle ou de la configuration risque d'avoir une incidence sur les performances effectives. Consultez d'autres sources d'information pour évaluer les performances alors que vous considérez un achat. Pour en savoir plus sur les performances et les résultats des bancs d'essai, rendez-vous sur www.intel.com/benchmarks. Intel® et Quartus® sont des marques commerciales ou déposées d'Intel Corporation ou de ses filiales aux États-Unis et/ou dans d’autres pays.
Autres ressources
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