Identifiant de l'article: 000074027 Type de contenu: Messages d'erreur Dernière révision :: 12/13/2016

Erreur :18496 La sortie <name> dans l’emplacement des broches <name> (pad_<number>) est trop proche de la broche d’entrée de l’horloge PLL (<name>) dans l’emplacement des broches <name> (pad_<number>)</number></name></name></number></name><...

Environnement

  • Intel® Quartus® Prime Standard Edition
  • All

    BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    En raison d’un problème dans la version 16.0 et antérieure du logiciel Quartus® Prime, vous pouvez constater cette erreur d’installation lorsque la conception du package MAX® 10 E144 est compilée sur le système d’exploitation Windows avec les conditions suivantes :

    1. Signal PLL connecté (signal d’horloge d’entrée non PLL) à la broche d’horloge d’entrée PLL

    2. Broche de sortie attribuée à côté de la broche d’horloge d’entrée PLL qui est connectée au signal PLL (signal d’horloge d’entrée non PLL)

    Solution

    Un correctif est disponible pour résoudre ce problème dans la version 16.1 du logiciel Quartus Prime Standard edition. Téléchargez et installez le correctif 0.01cb à partir du lien approprié ci-dessous. Veillez à lire le lisez-moi pour plus d’informations.

     

    Téléchargez le logiciel Quartus Prime Standard version 16.1 du correctif 0.01cb pour Windows (.exe)

    Téléchargez le logiciel Quartus Prime Standard version 16.1 du correctif 0.01cb Readme (.txt)

     

    Ce problème est résolu dans la version 16.1 du logiciel Quartus Prime Standard 2.

    Produits associés

    Cet article concerne 1 Produits

    FPGA Intel® MAX® 10

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