ID de l'article: 000077407 Type de contenu: Dépannage Dernière révision: 11/10/2019

Pourquoi le paramètre de bande passante ne change-t-il pas lors de l’utilisation de l’IP FPGA fPLL Intel® Arria® 10/Cyclone® 10 en mode SDI_Direct ?

Environnement

  • Intel® Quartus® Prime Pro Edition
  • Intel® Quartus® Prime Standard Edition
  • FPGA Intel® Arria® 10 Cyclone® 10 IP fPLL
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Lorsque vous utilisez l’IP FPGA fPLL Intel® Arria® 10/Cyclone® 10 en mode SDI_Direct, le réglage de la bande passante est fixé sur une configuration optimale. Par conséquent, les modifications apportées au paramètre de bande passante (Faible, Moyen, Élevé) dans cette IP ne seront pas appliquées au fichier MIF généré.

    Résolution

    Il s’agit d’un comportement attendu.

    Produits associés

    Cet article concerne 2 produits

    FPGA Intel® Cyclone® 10 GX
    FPGA et FPGA SoC Intel® Arria® 10

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