En raison d’un problème connu dans la version 14.1 du logiciel Quartus® II, le LVDS RX soft Intel® FPGA IP en mode PLL externe, peut ne pas fonctionner correctement dans Intel® MAX® 10 périphériques.
Cela est dû au fait que les ports rx_syncclock et rx_readclock ne se trouvent pas dans les Intel MAX 10 FPGA Intel FPGA IP LVDS soft, ce qui entraîne l’exposition de données collées aux données parallèles rx_out .
Pour contourner ce problème, changez la Intel FPGA IP soft LVDS RX en mode PLL interne.
Ce problème devrait être résolu dans une prochaine version du logiciel Intel Quartus.