Identifiant de l'article : 000083665 Type de contenu: Messages d'erreur Dernière révision : 01/26/2015

Avertissement (12620) : l’OE du port d’entrée de la mémoire tampon de sortie des E/S n’est pas connecté, mais l’atom pilote un port bi-direct

Environnement

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descriptif

En raison d’un problème dans les versions 14.1 et antérieures du logiciel Quartus® II, vous pouvez voir cet avertissement lors de la connexion de l’entrée d’une mémoire tampon bidirectionnelle à un zéro constant lors du ciblage de la famille d’appareils Arria® 10.

Le problème se produit en raison d’un problème de synthèse dans lequel les ports OE et IN de la mémoire tampon bidirectionnelle sont commutés.

Le problème de synthèse concerne toutes les autres familles de périphériques, mais l’avertissement n’est actuellement émis que pour la famille de périphériques Arria 10

Solution

Pour contourner ce problème, utilisez l’attribut « keep » (conserver) pour préserver le fil constant comme indiqué dans le code ci-dessous :

Pour VHDL :

const_zero_sig de signal : std_logic ;

attribut conserver : systène ;
attribut conserver de const_zero_sig : le signal est vrai ;

Commencer

const_zero_sig <= \'0\';

TRI_PIN <= const_zero_sig lorsque ENABLE=\'1\' d’autre \'Z\';

Pour Verilog HDL :

conserver les const_zero_sig de synthèse /* */;

attribuer const_zero_sig = 1\'b0 ;
attribuer TRI_PIN = activer ? const_zero_sig : \'bz ;


Ce problème devrait être résolu dans une prochaine version du logiciel Quartus II.

Produits associés

Cet article concerne 3 Produits

FPGA SoC Intel® Arria® 10 GX
FPGA Intel® Arria® 10 GX
FPGA Intel® Arria® 10 GT

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