ID de l'article: 000084393 Type de contenu: Dépannage Dernière révision: 11/09/2012

Puis-je utiliser un bloc de contrôle d’horloge pour choisir entre un débit PLL amélioré et un débit PLL rapide dans les périphériques Stratix II et Stratix II GX pour ma conception ?

Environnement

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descriptif

Non, vous ne pouvez pas utiliser un bloc de contrôle d’horloge pour choisir entre un débit PLL amélioré et un débit PLL rapide dans les périphériques Stratix® II et Stratix II GX. Les ressources mondiales et régionales utilisées par des LPP améliorés et rapides sont différentes.

Vous pourrez utiliser les sorties de deux plL améliorés différents ou de deux PLL rapides différents du même côté du périphérique qui partagent des ressources mondiales et régionales.

Pour plus d’informations sur les connexions réseau d’horloge mondiales et régionales utilisées par chaque PLL, reportez-vous à la section Stratix II du manuel LP dans les périphériques GX Stratix II et Stratix II (PDF).

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Cet article concerne 2 produits

FPGA Stratix® II GX
FPGA Stratix® II

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