Non, vous n’avez pas besoin de préserver les broches de l’émetteur inutilisé d’une PLL de canal E-Tile sur le Intel® Stratix® 10 ou le Intel Agilex® 7 E-Tile FPGAs.
Exemple : si votre conception actuelle implémente une PLL de canal E-Tile à l’emplacement 4 qui horloge les canaux E-Tile 0-3 en mode d’horloge EMIB externe, vous n’avez pas besoin de préserver les broches TX du canal 4 si ce canal était plus tard utilisé comme canal de données au lieu d’un PLL de canal.
Ces informations seront ajoutées à une future révision du Guide de l’utilisateur de l’émetteur-récepteur E-Tile PHY.