ID de l'article: 000089948 Type de contenu: Dépannage Dernière révision: 20/03/2023

Dois-je préserver les broches de l’émetteur inutilisé d’un PLL de canal E-Tile sur le Intel® Stratix® 10 ou le FPGAs E-Tile Intel Agilex® 7 ?

Environnement

  • Intel® Quartus® Prime Pro Edition
  • Émetteur-récepteur natif PHY E-Tile Stratix® 10
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descriptif

    Non, vous n’avez pas besoin de préserver les broches de l’émetteur inutilisé d’une PLL de canal E-Tile sur le Intel® Stratix® 10 ou le Intel Agilex® 7 E-Tile FPGAs.

    Exemple : si votre conception actuelle implémente une PLL de canal E-Tile à l’emplacement 4 qui horloge les canaux E-Tile 0-3 en mode d’horloge EMIB externe, vous n’avez pas besoin de préserver les broches TX du canal 4 si ce canal était plus tard utilisé comme canal de données au lieu d’un PLL de canal.

     

     

     

    Résolution

    Ces informations seront ajoutées à une future révision du Guide de l’utilisateur de l’émetteur-récepteur E-Tile PHY.

    Produits associés

    Cet article concerne 4 produits

    FPGA et FPGA SoC Intel® Agilex™ série F
    FPGA Intel® Stratix® 10 DX
    FPGA Intel® Stratix® 10 MX
    FPGA Intel® Stratix® 10 TX

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    Avertissement

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