Centre d’assistance pour la gestion des E/S et le développement des cartes
Documentation, formation et outils pour la planification et l’approbation précoces des E/S
Le logiciel Intel® Quartus® Prime dispose d’outils de gestion des E/S pour la planification et l’approbation précoces des E/S.
Lors de la planification de vos broches d’E/S, préparez votre conception Intel FPGA pour l’intégration des PCB.
- Créez des modèles de trace de carte « sensibles à la carte » dans le logiciel Quartus Prime pour obtenir des mesures d’intégrité du signal d’E/S ou générez des modèles IBIS/HSPICE pour la simulation dans des outils de simulation d’intégrité du signal tiers.
- Exportez les brochages d’E/S pour créer des symboles schématiques personnalisés à utiliser dans les outils de capture de schémas les plus courants.
Tableau 1. Documentation sur la gestion des E/S
Ressource |
Édition du logiciel | Description |
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AN775 : Directives de génération d’informations de synchronisation des E/S |
Pro et Standard | Les informations de synchronisation des E/S sont cruciales pour une analyse précoce pendant les étapes de conception des cartes PCB. Générez des paramètres de synchronisation pour vous aider à ajuster le budget de synchronisation de votre conception, en tenant compte des normes d’E/S et du placement des broches. |
Gestion des E/S | Pro | Ce chapitre du manuel Intel Quartus Prime Pro Edition et Intel Quartus édition Prime Standard traite Intel FPGA flux de planification des E/S, en détaillant comment et quand utiliser les nombreux outils de planification des E/S tels que le planificateur de broches. Il décrit comment créer des fichiers HDL de haut niveau en utilisant le flux de planification des E/S précoce du planificateur de broches avec des mégafonctions personnalisées. Il décrit la méthodologie pour les affectations et l’analyse des E/S, et traite de l’analyse avancée de la synchronisation des E/S avec des modèles de trace de carte dans Intel Quartus logiciels Prime Pro Edition et Intel Quartus Prime Standard Edition. |
Gestion des E/S | Standard | |
Analyse et optimisation du bruit de commutation simultanée (SSN) | Standard | Ce chapitre du manuel Intel Quartus Prime Standard Edition explique comment utiliser l’analyseur et l’outil d’optimisation SSN dans Intel Quartus logiciel Prime Standard Edition 9.0 et versions ultérieures. Il traite du flux d’outils et explique ce qui est nécessaire pour effectuer une analyse SSN précise dans votre conception Intel FPGA. Il décrit également les techniques et les paramètres d’optimisation SSN du logiciel Intel Quartus édition Prime Standard. |
Tableau 2. Formation et démonstrations de gestion des E/S
Ressource |
Édition du logiciel | Description |
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Introduction à l’utilisation du logiciel Intel® Quartus® Prime Standard Edition |
Standard | Vous apprendrez à utiliser Intel® Quartus® logiciel Prime Standard Edition pour développer un design Intel FPGA. Vous allez créer un nouveau projet, effectuer les paramètres utilisateur et les affectations, compiler, simuler et configurer votre appareil pour voir la conception fonctionner dans le système.
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Conception de systèmes d’E/S rapides et faciles avec Interface Planner | Pro | Dans cette formation, découvrez Interface Planner, anciennement connu sous le nom de BluePrint, un outil facile à utiliser dans le logiciel Intel® Quartus® Prime Pro Edition qui utilise la puissance du Fitter pour créer un plan d’étage légal en quelques minutes. Effectuez des affectations d’emplacement de ressources légales garanties interface par interface, au lieu de broche par broche, pour raccourcir votre cycle de planification des E/S.
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Analyse des assignations d’E/S | Sans objet | Voir une démonstration rapide sur les outils d’affectation d’E/S du logiciel Quartus II. Vous apprendrez à utiliser les fonctionnalités Interface Planner du logiciel Prime Pro Edition Intel Quartus.
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Tableau 3. Documentation sur la conception du PCB
Documentation disponible pour les outils PCB tiers
Guide de l’utilisateur | Edition logicielle | Description |
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Assistance des outils de conception de cartes Cadence | Pro | Décrit la prise en charge des outils de conception de circuits imprimés tiers en option par Siemens EDA et Cadence*. Comprend également des informations sur l’analyse de l’intégrité du signal et les simulations avec les modèles HSPICE et IBIS. |
Assistance des outils de conception de cartes Cadence | Standard | |
Prise en charge des outils de conception de circuits imprimés Siemens EDA | Pro | Le logiciel Mentor Graphics* I/O Designer vous permet de tirer parti du flux complet de conception de symboles, de création, d’édition et de rétro-annotation de l’FPGA pris en charge par les outils Mentor Graphics*. |
Assistance des outils de conception de circuits imprimés Mentor Graphics* | Standard | |
Gestion des broches d’E/S de l’appareil | Pro | Ce chapitre décrit la planification et l’affectation efficaces des broches d’E/S dans votre appareil cible. Tenez compte des normes d’E/S, des règles de placement des broches et des caractéristiques de votre PCB dès le début de la phase de conception. |
Gestion des broches d’E/S de l’appareil | Standard | |
Guide de l’utilisateur de l’outil PDN (PowerDelivery Network) 2.0 spécifique à l’appareil | Sans objet | Un bref aperçu des onglets de l’outil PDN 2.0 spécifiques à l’appareil pour tous les appareils. |
Conseiller en conception de cartes à haut débit pour PDN | Sans objet |
Ce document contient un didacticiel étape par étape et une liste de contrôle des meilleures pratiques pour la conception et l’examen d’un réseau de distribution d’alimentation (PDN). |
AN 224 : Directives pour la disposition des cartes à haut débit | Sans objet | Inclut des informations et des suggestions pour la conception et la mise en page de cartes haut débit avec Intel FPGAs. |
Manuel des périphériques de mémoire externe, chapitre 5, Conceptions de cartes à haut débit | Sans objet | Fournit des informations générales sur la conception des cartes à haut débit. |
Tableau 4. Ressources de conception de circuits imprimés
Ressource |
Édition du logiciel | Description |
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Sans objet | L’outil de conception de réseau de distribution d’alimentation (PDN) facile à utiliser est un outil graphique utilisé avec tous les FPGAs Intel® pour optimiser le PDN au niveau de la carte. L’objectif du PDN au niveau de la carte est de distribuer l’alimentation et les courants de retour du module de régulation de tension (VRM) aux alimentations FPGA, et de soutenir une intégrité optimale du signal de l’émetteur-récepteur et des performances FPGA. |
Tableau 5. Ressources d’intégrité du signal au niveau de la carte
Ressources disponibles pour l’analyse de l’intégrité du signal au niveau de la carte
Ressource |
Édition du logiciel | Description |
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Analyse de l’intégrité du signal avec des outils tiers | Pro | Avec la vitesse de fonctionnement sans cesse croissante des interfaces dans la conception FPGA traditionnelle, les marges de synchronisation et d’intégrité du signal entre le FPGA et les autres appareils de la carte doivent être conformes aux spécifications et à la tolérance avant de construire un PCB. |
Analyse de l’intégrité du signal avec des outils tiers | Standard | |
Sélection du modèle d’E/S : IBIS ou HSPICE | Pro | Le logiciel Intel® Quartus® Prime peut exporter deux types différents de modèles d’E/S utiles pour différentes situations de simulation : les modèles IBIS et les modèles HSPICE. |
Sélection du modèle d’E/S : IBIS ou HSPICE | Standard |
Tableau 6. Analyse de l’intégrité du signal
Cours de formation pour l’analyse de l’intégrité du signal
Ressource |
Édition du logiciel | Description |
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Simulation de canal SerDes avec des modèles IBIS-AMI | Pro et Standard | Au cours de cette formation, vous apprendrez la nécessité d’une simulation et d’une analyse précises de l’intégrité du signal lors de la conception de circuits imprimés à haut débit utilisant des émetteurs-récepteurs Intel® FPGA.
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